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2011년 LG CNS SI/SM 최종 합격 자소서입...

태그: LG CNS 합격 자소서, 자기소개서, 자소서, LG CNS 자소서, SISM LG CNS SI/SM 최종 합격 자소서입니다. 모두 이 자료 보시고 참고하셔서 LG CNS에 합격하셨으면 좋겠습니다. 감사합니다. 1. LG CNS에 관심을 갖게된 계기와 입사지원을 하게 된 동기에 대해 말씀해 주십시오. 최대 1000byte (현재: 0byte 제가 만들고 싶은 LG CNS는요. 2002년 8월, 영화 마이너리티 리포트를 보고 신선한 충격에 빠진 적이 있습니다. 자기부상 2. 지원분야를 선택하신 사유와 입사 후 10년 뒤 본인의 모습을 기재해 주십시오. 최대 1000byte (현재: 0byte 클라우드 컴퓨팅 전문가가 되고 싶습니다. 정보통신산업분야의 신성장 동력 중에 하나는 클라우드 컴퓨팅입니다. ..

2011년 하반기 노틸러스 효성 연구개발(전...

태그: 노틸러스 효성 합격 .., 자소서, 자기소개서, 노틸러스, 효성, 연구개발, 전자 노틸러스효성 연구개발(전자)직에 최종합격한 자소서입니다. 이 자소서 보시고 다들 합격하셨으면 좋겠습니다. 감사합니다. 1. 자신의 성장과정과 학창시절을 기술하여 주십시오. Can do it Spirit. 어려서부터 ‘한번 시작했으면 끝장을 봐라’는 아버지의 말을 듣고 자라서, 무슨 일이든지 한 2. 자신의 성격 및 남다른 지식이나 재능에 대하여 기술하여 주십시오. Positive Mind 제 이름은 밝고 환한 인물이 되라는 뜻이 포함되어있습니다. 그 뜻대로 항상 긍정적인 사고 3. 인생에서 성공했던 경험과 실패했던 경험을 기술하여 주십시오. Impossible is nothing 2011년 7월 안드로이드 앱개발을 ..

Chapter 6 Defining the Design Environment

Design Compiler User Guide Chapter 6을 제가 읽으면서 정리한 내용입니다. • Defining the Operating Conditions • Defining Wire Load Models • Modeling the System Interface • Setting Logic Constraints on Ports • Specifying Power Intent • Support for Multicorner-Multimode Designs Defining the Operating Conditions Operating Conditions에는 다음 3가지가 있다. 1. 온도 변화 2. 공급 전압 변화 3. 공정 변화 대부분의 techonology library에는 미리 정의된 opera..

일본 밴드 추천 5 - YUI

YUI (ユイ 유이[*], 1987년 3월 26일~)는 일본의 여성 싱어송라이터이다. 본명은 밝히지 않고[1] 활동하고 있다. 일본 후쿠오카 현에서 태어났다. ~ 2004년 : 데뷔 이전 철 들기 전에 이미 아버지는 없었고, 어머니와 단 둘이 살았다. 아버지에 대해선 아무것도 기억나지 않는다고 한다. 어린 시절은 동네 친구들과 뛰어놀기 좋아하는 활발한 아이였다. 그 무렵부터, 막연하게 가수가 되고 싶다는 마음을 품게 되었다. 중학교 3학년이 되어서는 노트에 시를 쓰기 시작했다. 고등학교에 진학한 뒤, 학비를 벌기 위해 아르바이트를 시작하였으나 일과 학업을 병행하느라 무리한 나머지 입원하게 된다. 퇴원한 뒤, 고등학교를 중퇴하였다. 거리 라이브를 하던 비안코네로(일본의 4인조 밴드)에게 음악학원에 대한 이..

디지털집적회로설계 MAGIC으로 NAND와 INVE...

태그: 디지털집적회로, MAGIC, magic, 반도체 레이아웃 설.., 레이아웃 설계, 디지털집적회로설계, NAND, INVERTER, 반도체, 반도체 레이아웃 NAND와 INVERTER를 이용해서 AND를 설계하는 과제입니다. MAGIC툴을 이용했구요. 물론 10점만점 받은 리포트 입니다. SPICE 코드까지 넣어놨으니 이해하기 편하실 겁니다. 1. INVERTER SPICE 2. NAND SPICE 3. AND SPICE 4. INVERTER LAYOUT 5. NAND LAYOUT 6. AND LAYOUT -INVERTER SPICE- -NAND SPICE- -AND SPICE- -inverter layout 화면입니다- -NAND layout 화면입니다- -AND layout 화면입니다- 없음 h..

디지털집적회로 MAGIC을 이용한 전가산기(...

태그: 디지털집적회로, 전가산기, 반도체 레이아웃, MAGIC, HSPICE, 디지털집적회로 MAGI.., full adder, HSPICE 시뮬레이션, 반도체 레이아웃 설.., 반도체 레이아웃 magic을 이용한 전가산기(full adder) 반도체 레이아웃 설계입니다. 10점만점 받았던 리포트 구요. 자세한 레이아웃과 spice 코드를 첨부 하였습니다. 그리고 HSPICE 시뮬레이션도 첨부하였구요. 1. 전가산기 진리표 2. HSPICE 시뮬레이션 3. SPICE 코드 4. LAYOUT 넷리스트입니다. * SPICE3 file created from adder.ext - technology: tsmc .lib `TSMC018.l` MOS .option scale=0.06u .global VDD Gnd..

디지털 집적회로 MAGIC을 이용한 Dual-Rail...

태그: 디지털집적회로설계, Dual Rail Domino, XOR, XNOR, magic, 디지털 집적회로, Rail Domino, HSPICE, 레이아웃 설계, HSPICE 시뮬레이션 1. Dual-Rail Domino XOR/XNOR 회로 및 레이아웃] 2. spice netlist 3. HSPICE 시뮬레이션 파형 4. 진리표 로 구성된 과제입니다. 10점만점 받았던 자료입니다. 1. Dual-Rail Domino XOR/XNOR 회로 및 레이아웃] 2. spice netlist 3. HSPICE 시뮬레이션 파형 4. 진리표 2. netlist * SPICE3 file created from dual.ext - technology: tsmc .lib `TSMC018.l` MOS .option sca..

집적회로 설계 과제 무어 법칙 및 polysili...

태그: 집적회로설계, 반도체소자, 반도체 물리, 물성공학, 무어의 법칙, mobility, 집적회로 설계 과제, 무어 법칙, polysilicon, electrons mobility Prob. 1) Please read the Moore’ paper “ramming more components onto integrated circuits” Electronics, Vol. 38, No 8, April, 1965. [10pts] (a) What are the things that Moore predicted correctly? (b) What are the things that Moore predicted incorrectly? Prob. 2) Why is polysilicon used instead of ..

IC설계에서 IP란 무엇인가?

시스템 IC 설계에서 말하는 IP(Intellectual Property) 는 재이용 가능한 기능블록을 지칭하며 하드웨어 또는 소프트웨어 기능블록을 의미합니다. 재이용 가능한 하드웨어 기능블록을 하드웨어 IP, 재이용 가능한 소프트웨어 기능블록을 소프트웨어 IP라고 합니다. 예를 들면, 프로세서, RAM, ROM 등의 기능블록은 하드웨어 IP이고, ARM 프로세서 상에서 실행 가능한 mp3 소프트웨어는 소프트웨어 IP입니다. 하드웨어 IP는 형태에 따라 소프트(Soft)IP, 펌(Firm)IP 및 하드(Hard)IP의 3가지로 분류할 수 있다. 1) 소프트 IP 소프트 IP란 일반적으로 하드웨어 기술언어로 쓰여진 논리 합성 가능한 설계 자산하드웨어 기술 언어는 VHDL과 Verilog 등이 이용되며, 합..

Chapter 7 Defining Design Constraints - Part 2

Design Compiler User guide 챕터 7 두번째 파트 입니다. 분량이 많아서 포스트 2개로 나눴습니다. Propagating Constraints in Hierarchical Designs hierarchical designs은 subdesigns을 가지고 있는데 이 경우에 constraint를 up 또는 down으로 전달할 수 있다. 1) Characterizing 특정한 셀 인스턴스의 contraints를 캡쳐하고 디자인에 셀이 연결된 정보를 할당한다. 2) Modeling chararterized된 디자인을 library cell로 만든다. 3) Propagating constraints up the hierarchy clocks, timing exceptions, 그리고 disab..

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